TMS320F28335与串行A／D转换器ADS7863的接口设计
来源： 作者： 发布时间：2015-01-09 14:30:54 浏览量：
2．2．1 ADS7863的主要引脚定义
ADS7863的主要引脚定义如下：CHxy+：同相模拟输入通道xy+(x代表A或B，y代表0或1，eg：A1+)；CHxy-：反相模拟输入通道xy～(x代表A或B，y代表0或1，eg：A1-)；M1：模式引脚1，选择SDOx数字输出，x代表A或B；贴片电感M0：模拟引脚0，选择模拟输入通道；SDI：串行数据输入，这个管脚允许使用ADS7863的增加功能，并且这些功能可以用在ADS7861的兼容模式上；CONVST：转换开始，不管CLOCK的状态，在CONVST的上升沿ADC从采样模式进入保持模式，转换本身在CLOCK的下一个上升沿开始；RD：读数据，SDOx输出与SDI输入的同步脉冲，RD只在
为低时触发；：芯片选择，当置低时，SDOx输出有效，当置高时，SDOx输出3态。CLOCK：外部时钟输入；BUSY：ADC共模电感忙碌指示符，当进入保持模式时，BUSY变成高电平，转换结束后，BUSY变成低电平；SDOB：转换器B的串行数据输出，在CLOCK的下降沿数据是有效的；SDOA：转换器A的串行数据输出，当M1为高时，SDOA与SDOB都是有效的，数据在CLOCK的下降沿是有效的。
2．2．2 ADS7863的工作原理
ADS7863的工作模式根据M0，M1的不同配置分为四种绕行电感，如表1所示。本文主要介绍ADS7863的M0=0，M1=1模式时的工作原理。当M0=0、M1= 1时，ADS7863工作在人为通道控制模式，数据只在SDOA脚输出，SDOB脚置为3态。SDI选择不同的模拟输入通道。当CONVST置高时，一个转换被触发。ADS7863需要32个CLOCK周期从两个模／数转换器ADCs输出转换结果，需要1．0μs完成一个完整的CONVERSION／READ周期。如果CONV-ST信号每0．5μs被触发一次(RD信号的需要)，那么每第二个脉冲被忽略。在CONVST的上升沿，不管CLOCK的状态，ADC从采样模式进入保持模式。经过一些延迟，BUSY信号变成高电平，并且在转换周期内保持高电平。在第二个时钟的下降沿，根据SDI寄存器的C[1：0]两位的状态，ADS7863选择使用下一个转换周期的模拟输入通道。CS必须置为低电平以使能SDOA输出。在每个转换的每32个CLOCK周期的下降沿，数据是有效的。输出数据由一个‘0’，紧接一个ADC指示符(CHAx为‘0’，CHBx为‘1’)，12位转换结果，和一个‘00’组成。
相应的时序图如图3所示。
3 TMS320F28335 McBSP与ADS7863接口设计
3．1 硬件接口设计
图4是TMS320F2差模电感器8335 McBSP与ADS7863无缝连接的示意图。从图中可以看出，McBSP与ADS7863之间的连接非常简单，实现了数据的高效转移，充分体现了同步串口连接的优点。由F28335 DSP的GPIO11向ADS7863提供片选信号。McBSP的数据发送DX脚接ADS7863的SDI脚，向ADS7863发出控制信号。ADS7863的SDOA脚接McBSP的数据接收DR脚，向F28335传送数据信号。由MeBSP内含的可编程采样率发生器生成时钟信号CLKG和帧同步信号FSG。由CLKG驱动发送时钟信号CLKX，CLKX驱动接收时钟信号CLKR和ADS7863的时钟信号CLOCK。由FSG驱动发送帧同步信号FSX，FSX驱动接收帧同步信号FSR和ADS7863的开始转换信号CONVST。CONVST初始化一个转换进程，并启动发送前一周期转换的数据。为了简化，只连接了ADS7863的CHA1+和CHB1+通道，可用输出数据的第二位(ADC指示符)分辨所采样的信号来自哪个通道。
3．2 软件接口设计
3．2．1 McBSP口初始化
整个初始化过程包括三部分：接收部分初始化、发送部分初始化和采样率发生器初始化。
(1)DSP初始化后，采样率发生器的初始化位GRST=0；在其他情况下，也可通过向SPCR2寄存器中的GRST位置0，使采样率发生器处于初始化状态。在此状态下，时钟CLKG时钟为CPU时钟的1／2，帧同步信号FSG为逻辑0；设置接收初始化位RRST、发送初始化位XRST和帧同步发生器初始化位FRST为0；
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