驱动集成电路功率级中瞬态问题的处理
来源： 作者： 发布时间：2016-10-27 07:01:40 浏览量：（2） 悬浮电源；VB-VS
多数桥电路使用上百伏电压，就是说应选择Y轴较迟钝的示波器以防止输入放大器饱和，这将使相对较小的VS负过冲很难量化。为了得到最佳分辨率，请阅读示波器手册，选择最高的可利用的灵敏度。
为了测量第二个信号，该信号始终附加在变化的桥电压上，因此要使用变 压器将示波器悬浮起来，但是不建议用这种方法。因为容性负载将影响电路性能，有时会掩盖问题根本原因而由于不注意而减小了dv/dt。
高带宽差分电压探头（或隔离的差分输入示波器）可以得到很好的结果，同时又允许观测其它地为参考点的信号。然而，当比较差分探头和常规探头相对时间时，应注意延迟时间的差异。
高端信号（Vb、HO）的共模噪声可以将探头正端和探头地端共同接到VS点测到。
不要认为低端没有共模噪音，同样可以将探头和地端一起接到COM点测到。
7．一般建议
下列建议在使用驱动电路是很好的实践和证明，无论观察到的锁定安全区如何。
最小化图1中的杂质参数：
1a、使用宽线直接连接两个器件，不要有环路和远离；
1b、避免互相连接，这会增加很大电感；
1c、降低器件安装高度，以减小管脚电感影响；
1d、两个功率器件并排放置，减小线长度。
减小驱动IC杂数电感：
2a、如图6所示连接VS和COM；
2b、使用 短的直接连线减小门极电路杂散电感；
2c、驱动IC距离功率器件越近越好。
改善耦合
3a、提高自举电容（Cb）值，至少使用一个低ESR电容，减小由于VS负
过冲而产生的过充电。
3b、在VCC和COM间使用第二个低ESR电容，这个电容为低端输出缓冲
电路和自举电路再充电推供电源，
建议该值至少是Cb的十倍。
3c、尽量将去耦电容靠近相应的管脚，如图7。
3d、如果需要在自举二极管中串联电阻，要确保VB不会降到COM以下，
特别是在启动时和极端频率和占空比下。
适当的利用上述推荐方法，可以从根本最小化VS负过冲的影响，如果负过冲水平仍然很高，就应考虑减小dv/dt了。
也许可以用外部吸收电路或增加栅极驱动电阻来折衰效率和开关速率。如果系统不能允许，应适当考虑快速反并联嵌位二极管，HEXFRED是理想的选择。
8．提升VS负过冲免疫力
在最坏条件下，如果主要信号在确定的极限值内，就不再需要采取措施。然而，在噪声非常大的环境中，采用上面措施，VS负过冲仍然超过，就需要进一步提高驱动IC的容错能力。我们推荐两种不同方法来改善负过冲免疫力。
方法A：
在VS脚到桥 电感生产 电路中点串联电阻，限制当负过冲时流入VS脚的电流。当电阻为或更低时是可以的。
既然自举电容充电经过此电阻，如图8，如果此电阻值过大，可能在启动时引起直通发生。如果有栅极电阻，栅极电阻应减小，以保证高端和低端栅极电阻相等。
方法B：
另外一个方法是：在COM和低端器件源极或发射极加入一个电阻，如图9，而自举电容充电不经过此电阻，这种方法较灵活，可选择较大的电阻并提供很好的保护。
这个电阻可限制流入600V二极管D2的电流（图3），同样，驱动的对称性要求高低端栅极电阻相等，所以低端栅极电阻应适应减小以满足要求。
注意：
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当使用的驱动IC没有分开的逻辑地时，例如有些IC的输入和输出共享一个地COM，上述讨论的两种方法都可以应用，然而应注意并确保输入逻辑在允许电平内。
9．附录电感器参数1 : IR2110寄生二极管结构
图10是IR2110的寄生二极管结构图，这基本体现了绝对最大额定值表。IR2110有独立逻辑地和输出地，在某些驱动IC中，由于管脚的限制，这两个地合并为一个。
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