采用带有收发器的全系列40-nm FPGA 和ASIC 实现创新设计
来源： 作者： 发布时间：2016-06-23 09:03:09 浏览量：G.709 OTU-2 - - - 10.7
支持FEC 的OTN 10GbE - - - 11.1,11.3
HiGig+ 3.75 3.75 3.75 3.75
HyperTransport 3.0 - 0.4, 2.4, 2.8, 3.2 0.4, 2.4, 2.8, 3.2 2.8, 3.2
Altera 公司 采用带有收发器的全系列40-nm FPGA 和ASIC 实现创新设计
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注释：
(1) 10G 基本( 专用)
(2) 10G 光纤通道
(3) 包括SFI电感器图片-4.2 和SFI-5.1
(4) 10G SONET/SDH OC-192/STM-64
结论
提高带宽和数据速率需要更多、更快的收发器。各种标准、优异的背板信号完整性和协议要求推动了数字器件的收发器创新发展。为满足不同市场和应用的各类需求，数字器件必须在密度和特性上达到最佳组合，同时满足性能、功耗和成本目标。Altera 的40-nm 收发器FPGA 和ASIC 技术创新以及重新使用已有技术满足了这些需求，提供了最全面的收发器定制逻辑系列产品。
采用了相同的成熟收发器体系结构来开发Altera 所有的40-nm 收发器FPGA 和ASIC，这种体系结构适合宽带串行接口应用。在每一器件中，针对目标应用优化了集成收发器模块。Arria II GX FPGA 是低功耗、高性价比FPGA 系列，大大简化了3.75-Gbps 收发器解决方案的实现。Stratix IV GX FPGA 是高性能器件，具有530K LE 和高级收发器，提供较大的存储器带宽。Stratix IV GT FPGA 是唯一集成了11.3-Gbps 收发器的FPGA，适合40G 和100G 应用。HardCopy IV GX ASIC 是封装和引脚与Stratix IV GX FPGA 相匹配的ASIC，有助于降低带有嵌入式收发器ASIC 设计的风险和总成本。此外，所有Altera 的定制逻辑器件都具有效能优势，包括统一全面的设计软件，一组通用知识产权(IP) 内核，并提供各种参考设计和设计实例。
表5. Altera 的高速协议电感器的识别和数据速率( 每通道Gbps)
协议Arria II GX Stratix IV GX HardCopy IV GX Stratix IV GT
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101 Innovation Drive
San Jose, CA 95134
详细信息
致谢
一体成型电感■ Bernhard Friebe，产品营销经理， Al差模电感器tera 公司。
■ Rishi Chugh，产品营销经理，低成本FPGA， Altera 公司。
■ Kevin Cackovic，战略营销高级经理，通信业务部，一体电感器 Altera 公司。
■ Martin Lee，战略营销高级经理，通信业务部， Altera 公司。
■ Martin Won，技术组资深成员，产品营销， Altera 公司。
■ Mike Peng Li，博士，首席设计师/ 高级工程师，产品工程， Altera 公司。
■ Sergey Shumarayev，工程主管，模拟设计组， Altera 公司。
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